[問題] verilog合成有latch... - 看板Electronics - 批踢踢實業坊

想請問板上高手們有沒有其他的問題會導致latch的阿????? 因為我很確定我if ,else if,else 或是case,default,endcase都有寫可是合成完卻跟我說我 ...

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